430VXのdata sheetが無くて．．．。

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[1897] 430VXのdata sheetが無くて．．．。	proxyf.dti.ne.jp
[1897] 430VXのdata sheetが無くて．．．。
Blue Mondy さん	Posted in 1998-09-28 00:50:00
もうプッシュされてしまいましたが、以前にＶ２００の原発乗っ取りとＰＣＩクロックのことでここに書き込んだ者です。その時の内容は、原発乗っ取りに比例して上がる外部クロックに対し、ＰＣＩバスクロックを固定できないかというものでした。理由は単純、ＰＣＩバスにささっているＧＡ-ＰＩＩＨ８がクロックアップに付いてこれないからです。あれからいろいろと調べたり、実験したりして、結局ＰＣＩバスクロックと外部クロックが同期していなければダメだということが解りました。　それで、今度は４３０ＶＸがどのようにして外部クロックとＰＣＩバスクロックの同期を取っているのか知りたくて、ＩｎｔｅｌのHome Pageに行ってきましたが、すでに４３０ＶＸ以前のdata sheetはありませんでした。　どなたか４３０ＶＸの同期の取り方をご存じないでしょうか？またはdata sheet(容量が大きすぎて受け渡しが出来ないか．．．)をお持ちの方はいないでしょうか？　何せdata sheetが手元に無いので想像の域を出ませんが、ＰＣＩバスに供給するクロックの２倍のクロックを４３０ＶＸのどこかのピンに入れてあげれば、外部クロックとその１／２クロックの関係が保てて、同期が取れるのではないかと考えているのです。外部クロック９０ＭＨｚ、ＰＣＩバスクロック３３ＭＨｚ固定なんてことも出来ると踏んでいるんですが．．．。　もう、ＰＬＬの足上げ個所は１０個所以上になってますし、ここまで来たらとことんやってみないと気が済まないのです。　どうか情報をお願いします。
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毎黒仮節渡万さん	Posted in 1998-09-28 01:02:00
うん? Triton系は同期ではなかったでしょうか? どのように同期も何も、外部クロックを2分周してPCIクロックにしているはずです。つまり、常に同期しているということ。　PCIバスクロックを固定して外部クロックを上げるという場合は、常に非同期になります。逓倍になっていない以上、同期させることは不可能です。
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os さん	Posted in 1998-09-28 01:19:00
http://developer.intel.com/design/pcisets/schems/430vx_s.htm http://developer.intel.com/design/pcn/EMB_IA/d0000538.htm http://developer.intel.com/design/pcisets/designex/297469.htm http://developer.intel.com/design/pcisets/datashts/290553.HTM http://developer.intel.com/design/pcisets/SPECUPDT/297653.htm 多分このうちのどれかだろうと思います。もしこの中になければ http://developer.intel.com/design/pcisets/datashts/ のsearchで430VXで検索してみてください。多分見つかると思います。
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BlueMonday さん	Posted in 1998-09-28 01:21:00
おっ、早々とありがとうございます。で、早速ですが、Triton系が同期なのは解ります。もう少し、自分の想像していることを詳しく言わせてもらいますと以下の様になります。１．ＰＬＬでは、ただ外部クロックとその１／２クロック（ＰＣＩバスクロック）を生成しているに過ぎない。（ＰＬＬで生成されたクロックは同期していない）２．４３０ＶＸではＰＬＬで生成された外部クロックを２分周させて、ＰＣＩバスクロックに同期させている。３．従って、４３０ＶＸがＰＣＩバスに同期させるための外部クロックをＰＣＩバスクロックの２倍にして注入してやる。４．一方ＰＬＬでは、外部クロックを通常どおり供給し、ＰＣＩバスクロックは３２ＭＨｚ非同期モードで供給、さらにこの２倍のクロックを４３０ＶＸのどこかに注入し、ここで外部クロックとＰＣＩバスクロックの逓倍という関係を保つ。　というものですが、駄目なんですかね～。
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BlueMonday さん	Posted in 1998-09-28 02:56:00
さらにｏｓさん、ありがとうございます。全部頂いてきました。これらの資料で検討します。
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nakazy さん	Posted in 1998-09-28 16:33:00
BlueMondayさんのやり方は、CPU周りを早くしてVX周りのベースを66MHz、PCIを33MHzですか？もしそうなら、CPU周りとその他が非同期になってると思うのですが。
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BlueMonday さん	Posted in 1998-09-28 21:43:00
nakazyさん、ご指摘ありがとうございます。そのとおりですよね。Ｌ２もありますし、どこまで同期を保てばよいのかは検討するだけ無駄なんでしょうか？人柱覚悟であれこれ実験だけはしてみようと思いますが．．．。